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像是自己在設計電路
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" U# x" ~4 c# Q- C然後趕在CIC下限前9 _# g7 t# k" N% j) B
) u' f4 {0 }* Q1 n5 m* A3 N拼命的LAYOUT
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有時候,老師說要改規格
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或是其他人說你的LAYOUT要考量一堆要件時( N" U5 B( ~* V$ z# Q K
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那時候真的很吐血啊∼!∼!* e9 h2 Z9 c% j3 n m
6 J/ B* n1 h6 `1 t$ N% s. U8 z像我個人就覺得LAYOUT真的相當的累人
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尤其是再跑LVS的時候
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除錯debug真的是要人命啊∼!! |
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