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像是自己在設計電路
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然後趕在CIC下限前
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拼命的LAYOUT
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* }7 y( Q8 x( G$ K' Q/ }5 r3 O* s有時候,老師說要改規格
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' ?; Y& S; K- B! V( k& f或是其他人說你的LAYOUT要考量一堆要件時
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# M; }" \# n# ^ n4 k% J: D4 |那時候真的很吐血啊∼!∼!5 V- x* T9 [$ q3 E# P% ^
* e A2 \9 b3 q' d7 W4 k像我個人就覺得LAYOUT真的相當的累人8 X; S; B! H2 u) L {
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尤其是再跑LVS的時候3 Y* n/ X. E, @2 ]
5 N, ^7 e$ ]* [5 S7 M- @; d/ {除錯debug真的是要人命啊∼!! |
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