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[問題求助] buck设计中如何实现LDO模式?

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1#
發表於 2008-9-7 20:09:15 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
3Chipcoin
对于一个降压dc-dc,正常工作模式为WM,但当输入电源电压从较高值逐渐减小到接近甚至低于输出电压值时,占空比需要达到100%,也就是进入LDO模式,以最大化其驱动能力。请问如何实现这一点?请前辈不吝赐教。) `% w1 c& A* p9 g) `9 [3 J4 B
; F4 N* b& A+ d, o- o" r: Q3 i/ R
0 ]- o, @0 S* v" F* D/ }' [: G

8 _! v. Q( r* A- P6 A# w: u1 E9 [以下是 LDO 的相關討論:, U6 Q9 X3 q, W
Low Drop-Out Voltage Regulators 9 k. e! f* w6 |) r8 H  ?! e/ h
Rincon-Mora 《Analog IC Design with LDOs》
) v! y$ @* k; v3 g7 v! `. ~PMOS Low_Dropout Voltage Regulator Introduction
, n: B  d9 R9 {$ HLCD Driver 設計術語簡介[Chip123月刊資料]/ ]9 [8 o9 h/ \: d# }$ C
The evolution of voltage regulators with focus on LDO[NS講義]. o9 y: @/ U0 c! P3 Q/ t6 a8 m
Design of High-Performance Voltage Regulators
/ Y, C( Q; `/ A?教有?LDO的??
' t( q1 q  T/ TLDO DC-DC分壓電阻的疑問(等比例的差異!?)
/ l0 d; F0 L, r5 u2 R# _LDO??
+ T6 u' _! j9 h' [$ x" H9 r8 w! X高?LDO ????!
" x# Y- T8 q4 y7 R5 M6 n, ~7 U

& Y1 S  N9 p/ e. E( C2 Z
4 H, a4 E2 ?  @* Q[ 本帖最後由 sjhor 於 2009-5-15 06:52 PM 編輯 ]

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2#
 樓主| 發表於 2008-9-7 20:11:09 | 只看該作者
其实实现方式应该就是switch全开,也就是100%,只是我不明白如何检测,检测到什么信号后将进入这种模式?请多指教
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3#
發表於 2008-9-9 22:32:53 | 只看該作者
1. 如果你設計的Buck是可以開100% duty的話
# d+ {+ v9 u) k6 H1 _    根本不用檢測, 因為switch自動會全開  V4 |' G9 f2 z3 D" B* S2 q
2. 這樣子輸入電壓會經過電感才到輸出, No Good4 K, J- }2 o* j! ?
3. 可以用看FB, FB一直不夠的話就切到LDO mode7 D- w( [4 C& P: Q
4. 此討論比較適合"電源管理討論區"
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