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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:% H9 K9 N+ p. i+ T' g

3 j: Y( p7 b  Q  _想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程
  Q: N% Q5 M0 d2 L, A* zSYSTEMC擅長前段 , k, M# Q6 @, Y0 u: P% H( R
StstemVerilog則後段功力相當了得
7 ^; b+ A2 G/ K可惜這兩種標準還無法做有效率的整合  o$ w- t  ^; Y9 e" I
學界已經有很好的整合經驗$ s- D" W+ G' G3 z% u$ J( u  d
但是業界中小型還在探索階段或根本沒有: d) {% `( O! V% v6 p) E
大型的Design House & Design service company有專門的部門在研究
  x# q; a' A  L7 h但只是部分導入在複雜的SOC上
0 v+ s- R( m" n7 e3 f總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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