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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › PLL Jitter 量測
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[問題求助] PLL Jitter 量測

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1#
發表於 2007-12-14 21:53:47 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問要怎麼量clock jitter 比較正確8 V7 ?9 [0 @! U) O0 l
現在是用tek的儀器在量 不過感覺jitter
0 O/ s. t) `) ?) q& B跟你匡的box高度 寬度很有關係 還有trig level
3 V: j: Z7 B; J1 I也有關 ! Z1 A4 ^* O+ F
不知道 有沒有有經驗的版友 * L  s4 p& a9 F  h% \* G
可以告知如何正確的量clock jitter 感激不盡阿
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2#
發表於 2015-5-11 16:27:31 | 只看該作者
可惜了，台湾的大学只在台湾分享
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