設為首頁收藏本站
開啟輔助訪問 切換到窄版

Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步，快速開始

Login

用FB帳號登入

搜索
1 2 3 4
Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › 請問D flip-flop與TSPC間差異性
返回列表 發新帖
查看: 17753|回復: 14
打印 上一主題 下一主題

[問題求助] 請問D flip-flop與TSPC間差異性

[複製鏈接]
e2000
跳轉到指定樓層
1#
發表於 2009-7-8 20:31:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
爬文發現暫存器方面比較少資訊
8 g1 a6 D. \  C  T+ V- T- m目前在高頻電路像VCO，PLL方面的暫存器好像都是使用TSPC，那一般邏輯閘組成的D型正反器與TSPC之間的差異性在哪裡呢?
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂頂 踩踩 分享分享
回復

使用道具 舉報

2#
發表於 2009-7-9 10:32:25 | 只看該作者
簡單來說就是速度
! [8 ^- ^2 R6 x' T% ]% i一般PLL或VCO所產生的震盪頻率動則M或GHz
/ |( x" \9 r* e4 D9 K* \一般邏輯是無法轉換那麼快速故採用TSPC架構電路設計
回復 支持 反對

使用道具 舉報

e2000
3#
 樓主| 發表於 2009-7-9 14:06:58 | 只看該作者
那如果這樣子的話大家都採用TSPC應該更好，除了邏輯閘組成的正反器有兩個相位這個優點，速度以及電路速度都是TSPC佔優勢的樣子。
回復 支持 反對

使用道具 舉報

gyamwoo
4#
發表於 2009-7-13 03:57:51 | 只看該作者
除了速度之外，POWER也要考慮進去。因為速度高，POWER也會大。再說TSPC是動態邏輯，POWER會大很多吧
回復 支持 反對

使用道具 舉報

5#
發表於 2009-7-16 14:20:50 | 只看該作者
速度是最主要的考量! charge 可以快速累積導通! 其他type 好像沒這麼快!
回復 支持 反對

使用道具 舉報

e2000
6#
 樓主| 發表於 2009-7-16 14:41:20 | 只看該作者
所以使用邏輯閘的D flip flop到底好處在於哪裡呢?我怎麼越來越糊塗了.....
回復 支持 反對

使用道具 舉報

afor
7#
發表於 2009-7-18 14:05:06 | 只看該作者
在低頻時用TSPC 當DFF 會有問題" ^! l# ?& X) g# i# i
記得在MHz以下就沒在用TSPC。
回復 支持 反對

使用道具 舉報

8#
發表於 2009-7-19 13:58:59 | 只看該作者
除了功耗外，面積也是一個考量吧？
: _4 @( x. T7 `- F" R7 D( ^1 U$ T' }: {) p1 w) @3 S0 d
( c; a% j$ [; [7 A! f) z6 W
系統字數限制好煩人。。。。。。。。。。。。
回復 支持 反對

使用道具 舉報

rossbug
9#
發表於 2009-10-29 16:19:08 | 只看該作者
TSPC的電路速度快(只有三層)，但是需要漂亮的時脈，否則會錯，還有MOS的大小有時也得注意，有時TSPC會用在PLL的除二電路
  p. c% I$ m# O" r+ _. `. Z, A! dD-Flip flop 較robust但是慢(delay 大)
) f6 d. a% z: B
: `' C  B+ s, j% r[ 本帖最後由 rossbug 於 2009-10-29 04:25 PM 編輯 ]
回復 支持 反對

使用道具 舉報

10#
發表於 2009-11-14 20:43:50 | 只看該作者
又學到了一些東西
6 a2 \# ~- J, G2 E. K3 j2 H最近在做PFD也在想這方面的問題
回復 支持 反對

使用道具 舉報

11#
發表於 2012-2-1 15:36:54 | 只看該作者
沒錯，低頻時，TSPC的DFF銜接就會出問題囉
回復 支持 反對

使用道具 舉報

12#
發表於 2012-2-1 15:38:04 | 只看該作者
沒錯，低頻時，TSPC的DFF銜接就會出問題囉' f+ l$ r  x* j) E9 X1 ]9 y
功耗問題是可以改善的，可從放電路徑著手
回復 支持 反對

使用道具 舉報

13#
發表於 2012-2-1 15:38:27 | 只看該作者
沒錯，低頻時，TSPC的DFF銜接就會出問題囉
' a7 p- c) H! F# f1 H4 z功耗問題是可以改善的，可從放電路徑著手
回復 支持 反對

使用道具 舉報

14#
發表於 2013-4-10 15:02:06 | 只看該作者
是不是比logic gate 組成 的靜態power還要小  但動態power 要來的大 (大很多?)  
; q" h  B$ K# R! l; e7 UPower_dynamic  =  a * C *(V^2) * f  % r' L) a3 U$ n# d9 Y, }
靜態power小 是因為 mos 比較少顆而工作電流較少 ?
回復 支持 反對

使用道具 舉報

15#
發表於 2013-4-21 23:05:20 | 只看該作者
学习一下学习一下学习一下学习一下
回復 支持 反對

使用道具 舉報

返回列表 發新帖
高級模式
B Color Image Link Quote Code Smilies
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-5-7 01:54 PM , Processed in 0.112007 second(s), 17 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表