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[問題求助] 關於南科的邏輯分析儀Agilent 16903A

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1#
發表於 2009-8-13 15:31:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問若是我的flash adc的output buffer是使用open drain雙端輸出+ T7 N( `6 ^; [3 d+ F6 t: o  B) B
open drain的外接電阻應該估計多少(100歐姆或是500歐姆). \4 e' `. ]1 _! \2 J2 {
還有這台Agilent 16903A 可以判斷出差動訊號嗎?( }7 O7 a/ c. ?5 t4 A% T/ N
以下儀器資料摘自CIC網頁
/ U1 x9 W* t2 k3 t8 p: I7 E* dLogic  Analyzer:  Agilent  16903A
" @. i/ v4 B& @/ L. t6 n( w1 eLogic  analyzer  module:16760A
# L( P9 Z) a7 e- |* ^Channels:  34
. |8 A% J9 f1 Y# i) V( i+ [% \& kMaximum  state  rate  (half  channel):  800MHz$ `+ ^' U, p4 F# z) F7 ^
Memory  depth:  64M
# p! m0 ~# u+ M6 o( w" b$ A) AMaximum  date  rate:1.5  Gb/s8 S- }& L) E; A, A5 n1 w+ j/ {! P
Support  single-ended  and  differential  signals1 _! O. T' q, U! [/ @) i7 x
Pattern  generation  module:  16720A
' f& h; `. n) IChannels:  48
# k! ~) e6 i9 b: o; P; sMaximum  clock  (half  channel):  300MHz2 u9 y+ m( U( D' n9 f
Memory  depth:  8M
% r- f/ ?, u  M2 [, `2 GLogic  levels  supported:  1.8V,  2.5V,  3.3V
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2#
 樓主| 發表於 2009-8-21 10:04:53 | 只看該作者
南科詢問的結果是可以使用open drain的差動輸出7 C& n: }$ y/ ?8 l- M: H
不過還是不懂為何論文上不用inverter而要用open drain當output buffer
3#
 樓主| 發表於 2009-12-23 15:06:05 | 只看該作者
請問有人知道模擬adc若使用matlab: D0 ^& o7 j  i; V; |
要如何寫才可以使模擬結果接近量測的方式
. o* H! ?* c- i9 ]- n$ a8 G因為我發現寫法不同結果差很多
( N8 F  U8 s6 r" L/ m取的點數不同也會差很大% }! ]* i' V; W  a6 k1 q
請問應該取多少點才算準確又有效率呢
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