Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步,快速開始

Login

用FB帳號登入

搜索
1 2 3 4
查看: 11804|回復: 2
打印 上一主題 下一主題

[問題求助] deep n-well

  [複製鏈接]
跳轉到指定樓層
1#
發表於 2009-8-26 23:14:37 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我是剛設計rf電路新手,在設計好電路後layout時( G# D; |$ ^$ H1 `! @9 u- H& ]2 p

9 P# v* O6 a, ]0 ^發覺rf的mos最外圈有兩層,最內圈是body而最外圈是deep n-well' Z' G9 \0 z3 L1 M

' D( O) ~% i) w我那時不知道那是deep n-well,而在layout時nmos那圈我都接地
) E6 q  }* n! k( f8 Q/ w/ V- K
而pmos是那圈是已經跟body那圈接在一起了,所以我不需要動它. v( V! b$ [& l) A

4 L7 Y. t! [/ s" V; ]$ ~1 q8 @在我最近下線完後發覺好像不太對,我把nmos flatten掉才知道) h, n% g) y6 }; l' r

5 _& v7 n1 i: ~# n; g5 R" l+ g它叫deep n-well,nmos的body是p型,那我還把deep n-well接地
) r1 z6 T8 ^( z$ b, n) `0 Y6 V
那不是有可能順偏,我電路中body都跟source接在一起,而我的電7 {* i: h+ e; E  d! U1 m; S) l7 `- R
. M2 K# }! x$ U3 F* r
路中source又不一定接地,那這樣子我的電路很有可能不work嗎?
0 {2 E8 H3 a/ I- [# K. c4 l
) m5 B! |% ]0 u8 ^$ h; adeep n-well是一個電晶體配一個,還是整個wafer配一個,若是整個wafer
7 ]7 ]! ?" X) q4 T! |  q
: `% B6 L1 y/ J7 E, _4 F一個的話那我叫出電晶體時怎會最外可以讓我選擇如何接?9 v3 f& j: s' b3 p
1 X' u. e2 J6 ]2 B
那deep n-well我該怎樣接才對?1.與body接在一起2.不要接(浮接)8 _3 h, l$ N! ~  z. N7 w5 x
$ E; ~7 m: B7 I) N3 ?, m* u7 ?+ ]
3.接到最高電位。那種方式會比較好,而一般會用那種方法?% P; h& x7 x+ m% \9 R& k" ]1 `
& O9 y  l+ Y  j2 \# B
而我所使用的是.18製程。
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂81 踩 分享分享
2#
發表於 2009-11-22 16:24:00 | 只看該作者
我把這一篇推上來,因為我也有疑問,1 A3 W0 `2 \3 F9 b- ~6 d( x9 @+ b
過去其它製程剛好沒有deep n-well ,現在用TSMC.18的model發現有deep n-well ,  r2 C5 w! |3 ^
上課的時候說過這樣把所有的body都分開,所以可以單獨mos的s和b端接在一起,
, u3 _& M" ?. l# H) L6 s* A$ j& x可有違過去的經驗,雖為了怕bodyeffect而把sb端相接,
$ K" \# d% D1 w2 {可怕latch-up,所以把b端都接最負電源,
! s0 ]( ^# E, s$ _7 u4 B+ t; D如今.18有這樣的製程設計,是否表示可以把sb端相接 ? 只要外圍有deep n-well ?- W! D1 s8 ^9 T# G  }& L
有先進可以回答嗎?
3#
發表於 2009-11-24 15:33:56 | 只看該作者
Deep Nwell就是为了实现sub隔离用的
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-5-19 08:53 AM , Processed in 0.120016 second(s), 17 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表