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[問題求助] 請問TSMC 90nm DRC ERROR 麻煩了!感謝!

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1#
發表於 2009-9-20 16:20:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
由於之前都用CIC的虛擬製程.這是第一次用真的製程所以我完全沒有頭緒.請各位前輩幫幫忙.謝謝3 P" Q" Y# M' k: r0 d1 P: L
我LAY完一個子電路後跑DRC.但它出現以下幾個錯誤...(幾乎都是同一類錯誤.超多)# [: b7 G4 F1 X( A" _
1.  DOD.R.1 {@ DOD is a must. DOD CAD layer must be different from OD's.
# z' W) [% U# P- n' M3 a3 ^6 f% }                   CHIP_CHAMFERED NOT INTERACT DOD }
# p+ b2 P4 D: e2. CSR.R.1.NWi {@ NWi is not allowed inside the empty area of chip corner.
+ R4 m$ @- H( E                   EMPTY_AREA AND NWi }' b- P5 p, C7 r: }3 h2 n
3. DUTM.R.1 {@ DUTM is must. The DUTM CAD layer must be different from the the UTM CAD * Q& D& }! @" o5 Q/ C5 t/ {
                     layer.
) X) ^1 p- Z! q+ `% H# G$ r                     CHIP_CHAMFERED NOT INTERACT DUUTM }4 I5 c% n& G' P2 F8 K2 D: N/ m
8 L, m* L- E1 t8 k& ^
麻煩了!
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2#
發表於 2009-9-21 13:54:35 | 只看該作者
2.是不能在角落的地方放layer , B- A! t# R+ g; f; h, D
整體來看應該是 turn on ㄌ full chip check$ b2 V$ F% [% W6 m( d
在 DRC command file 先把它 mark 掉
* ~9 C; r; ~. c$ ^0 g在 whole chip 時再來 RUN 會比較清楚些
4 c- ?- F8 G& u1 m' F- T////#DEFINE FULL_CHIP
. f- X$ ^7 D8 [+ Y: u仔細研究一下 design rule
9 [4 ]! c$ ?* i- N& ~應該會有幫助
3#
 樓主| 發表於 2009-9-21 22:29:31 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉?9 J# N$ T! h( B) X
還有DRC command file是指那個file,就是跑drc那個file嗎?
/ s$ @" D; d5 S0 w, J2 C$ F& ^# c) k/ B" o- @; I0 C  \
還有再請問一個題外話!在畫MOS時.利用finger將mos的width 7 ^5 d5 _4 l+ \: ]0 v
變小.跟不用finger,width很大.有什麼差?如果不考慮noise
- q& I5 F& Q3 x; I/ k9 M) R也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?2 [  S( U" Q  F+ V+ f, ~3 u+ |  d2 p

6 b1 B$ l( D" s" |[ 本帖最後由 henry90176 於 2009-9-21 10:31 PM 編輯 ]
4#
發表於 2009-9-22 14:31:03 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉/ H  X. _, r1 H' p( B( u( _# H; i
就是在這行 //#DEFINE FULL_CHIP
5 |" z+ m; X- k在前面加 2 個 // 那行就被mark 不會被執行 (卡利柏驗證軟體)
% J+ @" N) f2 |6 e6 |! c如果是吸血鬼驗證軟體 就是在前面加一個分號  ;
& J2 x2 y2 g. {8 L' j# w( A 還有DRC command file是指那個file,就是跑drc那個file嗎?
# Z. i4 I) R0 f! C- y是的  有人說  rule file 也有人說  command file8 ^0 Q2 g! V. |0 P0 W% a7 r! d& M

' I6 M3 y; z$ c9 _3 C3 s% g/ w2 Y( z4 K還有再請問一個題外話!在畫MOS時.利用finger將mos的width : % c5 f0 d6 v# D8 F! s8 f7 d
變小.跟不用finger,width很大.有什麼差?如果不考慮noise
! \/ L2 r$ e3 t1 D2 v  也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?0 [" `7 x: W- M, U5 M; R
沒瞎密差,也沒瞎密不好 通常是以整體考慮 2 q; ?9 i7 o$ ^, q; e+ a, E
例如 整排都是 w=5   只有 一個 w=20  那就是 鶴立雞群ㄌ& |4 f% t$ n+ a: t* R" ~  h& ]
通常會做成 finger 4  統整高度, 這類問題會先和 designer 討論
! P( G0 N+ H. U* o& A8 ^後 做決定 有時電路有其考量  參考參考
* R" m7 z* G# s5 Q! h+ z
0 o! C+ m  p) E" i) D" |) Y:
5#
 樓主| 發表於 2009-9-22 19:18:00 | 只看該作者
真的很感謝M大!!問題大概解決了!!謝謝~~~!!!!!!!!
6#
發表於 2009-10-20 00:04:44 | 只看該作者
我知道卡利柏驗證軟體指的是calibre吧~
( I! q/ q% a# Q* e; e) _( C; u那可以請問一下吸血鬼驗証軟體是…!!?
7#
發表於 2009-10-21 14:48:26 | 只看該作者
原帖由 小包 於 2009-10-20 12:04 AM 發表 ( n3 N5 e  ^1 y: m! ^; u; ]
我知道卡利柏驗證軟體指的是calibre吧~
7 X1 e, C5 t1 i0 P$ Y那可以請問一下吸血鬼驗証軟體是…!!?
<<<<<沒記錯 virtuoso都是內建的DRACULA
8#
發表於 2009-10-22 22:58:07 | 只看該作者

回復 7# 的帖子

哈哈哈…所以吸血驗証軟體指的是dracula嗎!!?
) z, i: G" u/ ?4 M' Z" |$ D原來我一直在用的就是吸血驗証軟體…
3 ~: a& }/ j1 w$ L# r6 L1 w6 v  q) @這個名稱還滿好笑的……
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