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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:
( P% W! g0 V: Z7 X) T
/ H+ l2 Y7 u. g4 \( M想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程" h  X$ Y- W- M. `& Y8 h) I# O
SYSTEMC擅長前段
9 p4 [, Y' V; C. bStstemVerilog則後段功力相當了得8 e5 {' ?" |+ |3 w! p# O
可惜這兩種標準還無法做有效率的整合8 Y7 y4 x6 v  L) m  x3 O
學界已經有很好的整合經驗9 h  V7 l9 c# _) [4 x) m
但是業界中小型還在探索階段或根本沒有  p; W9 a$ e* n% ?+ w: `8 u
大型的Design House & Design service company有專門的部門在研究
- V+ i! w, a. G+ ]$ P% x1 U0 {但只是部分導入在複雜的SOC上
# |5 G$ S  ?( c6 L- }總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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