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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:" D& d4 ]. G5 e' d/ W! ^
4 h& I$ K( \/ h  J1 o
想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程6 q7 c  P: H+ P$ H2 Y3 u
SYSTEMC擅長前段 # H! a! p5 |6 M# E, Z
StstemVerilog則後段功力相當了得
& u7 D$ F8 e7 G2 W. b# _可惜這兩種標準還無法做有效率的整合8 y& x- j( \. B$ q' A
學界已經有很好的整合經驗3 l. n5 g+ P& T3 Y! z8 s1 p) a6 e
但是業界中小型還在探索階段或根本沒有: D' y7 o! v4 g. ~
大型的Design House & Design service company有專門的部門在研究
2 q& b1 |; i/ M8 B但只是部分導入在複雜的SOC上
' r2 ~8 ~# }2 ]( k" Y總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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