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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
各位學界或業界的先進:0 ~" S" b0 W; K7 n

( p% K  [7 E1 k9 L5 ^2 K' q想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程- Y$ s& c/ h  j% b: u) Y* L' T" r
SYSTEMC擅長前段 / i+ \4 k9 i; g. G- L+ R3 [# d% X$ h
StstemVerilog則後段功力相當了得9 q- F% ^/ `1 A( W+ S( p
可惜這兩種標準還無法做有效率的整合
/ C! r9 E% B" E4 d: `學界已經有很好的整合經驗
+ }, m$ b# L& q但是業界中小型還在探索階段或根本沒有
! `, b4 q! q: d% }( h5 A7 H大型的Design House & Design service company有專門的部門在研究
- K1 l6 r5 p9 U" r' X: _2 z/ _但只是部分導入在複雜的SOC上  r5 ^* k* m$ j% \
總之 越複雜大型的SOC 這種投資就相對顯得重要..
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