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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:6 ?' D8 w( x! h2 Z

! n& x7 u8 A3 G2 H' o想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程
9 K! L  p" l) L3 p! A% J, ^SYSTEMC擅長前段 * g- H) l+ M0 Z- _3 [1 E
StstemVerilog則後段功力相當了得
7 h& f: e" b* l  l可惜這兩種標準還無法做有效率的整合
, }$ o% t/ k$ C! k' n6 `學界已經有很好的整合經驗
+ `/ f8 R8 X- ~6 ~) r" f但是業界中小型還在探索階段或根本沒有
! r5 Z8 N( d) m大型的Design House & Design service company有專門的部門在研究
2 j, I; I0 }% G8 @# [但只是部分導入在複雜的SOC上
9 m- T5 g/ \0 ?% W總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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