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商周出版一本書: π型人:職場必勝成功術,,6 f* ]" ^) I8 m8 J1 \( X+ t) x
裡面提到「「π型人」的方法,讓你在最短時間內,選擇適合自己的第二專長,並與第一專長融合,發揮一加一大於二的威力,帶你安然度過景氣寒冬,成功迎接春天的到來。」
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1 ~" X [; ~& W2 W$ w" z% m* s在IC Layout世界裡, 小弟的解釋為: ( g6 z) Q, s5 J. b9 h! Z
IC Layout工程師,除了提升本身IC LAYOUT的技能外,(平常多閱讀國外期刊,美國佈局專利或進修等..)( d9 m. B% _& w
另外再學習和本身工作的前、後,也就是上下游相關的知識.5 p. g4 i# S6 V6 y+ C5 V# W
例如:IC設計和 晶圓製程或 CP測試6 e& Z% T& ^3 g' m- F( N
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(??? 有人一定會問我,IC LAYOUT 學IC設計和測試做啥?) 5 @! |- v: d; b! z
隨著製程演進, IC Layout在舊製程不存在的問題, 在前瞻製程未必不會碰到,- N& l' m; K q" M1 C r. e6 ]
" c+ e8 t* k" p* k! W" P學習IC設計並不是要超越IC Designer,而是為了能更清楚的溝通電路設計理念,
+ u5 y& @& c) L% N" ^學習晶圓製程或CP(Wafer sort)也不是要成為製程或測試工程師,,% |& R' J8 O4 H; b& v2 P
而是要了解自己的佈局在台積電裡面會怎麼跑, I/O PAD的擺放對CP(Wafer Sort)測試結果有沒有影響,或是可以最佳化
B( ]7 C( x: Z) Y) U o, J: H$ h當然公司或Fab一定會有舊的Rule可以依循, 但是Rule為什麼要這麼定通常了解不深(因為太忙了..沒空想那個)1 U# |( e5 j8 z0 o
5 @3 i/ q9 j N; i0 [所以試著了解上下游合作的工程師在做什麼,, 辛苦一陣子,,. j+ Q/ A, M" Y3 z
必然可以脫離 「像是在 做工ㄉ感覺得,, 」
. M8 K- m/ i: {8 M" ~ T
+ {- q& _ U' ?, J1 U* ?) O$ L, {共勉之~ |
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