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[問題求助] 請教antenna的問題

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1#
發表於 2008-5-9 15:01:28 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
這是目前在做whole chip整合發生的問題,當我antenna跑完,使用! [1 x& o2 f: g7 x# B
antenna diode去補後,antenna過了,但是lvs卻發生問題,某些線會
1 J( W3 n2 y' t$ C. z因為diode而有error,是類似斷線的錯誤,有些不會,當我不使用diode# ]& @  w- o/ A
而用換層的方式,卻又正常了,這到底是什麼原因.我確信diode沒有3 O3 ^- m# \6 ]8 W
跨在2條線間,使它們短路,也沒有放在用做區隔電壓的dummy layer8 p2 E' t6 x: g8 K/ ~8 x: z: s
下.; r8 H% k6 C- I  l& s
還有一個換層的問題,一般從製程來說是朝上換,是沒有疑問的,就我
4 f% N) I2 R; x% l1 x: o( l的理解,就朝上換一層就行,但是有人說要換top metal才行,昨天辯很
+ c# S- Q2 O! J5 O久,當然2種都會過,不理解的是,用top metal有什麼根據會比較好.
* t+ \* J5 V( @+ c% V) V& G
0 b5 V) S0 y' ][ 本帖最後由 sw5722 於 2008-5-9 03:07 PM 編輯 ]
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2#
發表於 2008-5-13 23:01:39 | 只看該作者

ANTENNA

TOP METAL 比較上層所以乾淨: Z+ I% R$ a5 S; O" B1 F
請RD改SPI檔請他加DIODE
3#
 樓主| 發表於 2008-5-15 09:58:46 | 只看該作者
TOP METAL是可以使帶有電荷的大面積metal,較慢與gate連接,* C; R2 G* y$ j0 V
但是top metal的rule遠大於一般metal,個人覺得使用上一層就能
" {; k, J8 W$ c3 C/ ?達到效果,也就是暫時中斷那些電去燒毀poly gate.3 o, w0 {# v# a" c. t) c+ t
一般來說我公司designer都不會在spi檔上加diode,因為出現的- B- f: f2 w) u/ w& J& h
error report是一樣的,但是在某些線上,會有其他的error.所以才會
( [: o2 R4 X! K4 p7 ^" e& Y用換層取代,只是不知道那些異常error發生原因.
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