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[問題求助] 請教antenna的問題

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1#
發表於 2008-5-9 15:01:28 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
這是目前在做whole chip整合發生的問題,當我antenna跑完,使用1 A% _, l1 Y& }% p) o7 c7 F* ]
antenna diode去補後,antenna過了,但是lvs卻發生問題,某些線會8 |$ L( a2 \! y3 X/ {8 k9 ~
因為diode而有error,是類似斷線的錯誤,有些不會,當我不使用diode
- }1 |" H1 o- H而用換層的方式,卻又正常了,這到底是什麼原因.我確信diode沒有& E( f1 F( C) D# i9 K, J
跨在2條線間,使它們短路,也沒有放在用做區隔電壓的dummy layer
  v' R8 L* t* s) w/ S下.1 H- o! K" H  n8 [( C3 `
還有一個換層的問題,一般從製程來說是朝上換,是沒有疑問的,就我
3 J) ^& b- E& ?) m( V5 l3 o的理解,就朝上換一層就行,但是有人說要換top metal才行,昨天辯很
  o7 D% @  ^" d& A1 P久,當然2種都會過,不理解的是,用top metal有什麼根據會比較好.5 H9 e7 M9 h& x, q0 X
  B9 l6 u3 |$ Y0 f4 @
[ 本帖最後由 sw5722 於 2008-5-9 03:07 PM 編輯 ]
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2#
 樓主| 發表於 2008-5-15 09:58:46 | 顯示全部樓層
TOP METAL是可以使帶有電荷的大面積metal,較慢與gate連接,
  e: M, |- Z# o! Y但是top metal的rule遠大於一般metal,個人覺得使用上一層就能/ `" c; b) R8 U4 _1 K# D
達到效果,也就是暫時中斷那些電去燒毀poly gate.+ |0 i5 J! x/ v( k5 E
一般來說我公司designer都不會在spi檔上加diode,因為出現的% S+ y+ i8 ~9 S- |3 M4 ~% V
error report是一樣的,但是在某些線上,會有其他的error.所以才會
8 ]3 ~5 C2 v" ^/ K: X" P用換層取代,只是不知道那些異常error發生原因.
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