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STD Cell Data Prepare 中 wire track 的問題?

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1#
發表於 2007-1-17 09:16:11 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
Standard Cell 的 Data Prepare 的過程我會去做 axgDefineWireTracks# y7 d) D9 ^/ `* D1 @
然後再做 axgCheckWireTrack 來 check wire track, 但是做完 axgCheckWireTrack    _( N% a5 y! x$ r; n
之後卻有如下之 Meaasge:
+ @9 {) a/ S0 [9 w; I9 d- G- w3 h6 L* W
******** Pin Access Analysis *******
+ l! O4 U- R9 v' N4 M; [, b** # Cell Masters    =  1000
' ~3 g4 [' D. j+ d, B5 Y
** # Ports (logical) = 2500
: N5 E, ?! X) _3 L** # Pins (physical) = 2500- e) B8 K$ }! @% m% ~
** # Pins with no good access point on Grid (V&H) =   5 ( 0%)% p# I9 j9 P: |1 g0 {' Q6 w
** # Pins with no good access point on Ver-Grid =    5 ( 0%)

" d- n1 C9 F' N( J6 h' k/ T: K+ q9 k- I( y7 L
請問下面這兩句是代表什麼意思呢?
' r1 B$ W1 j) q0 w0 f** # Pins with no good access point on Grid (V&H) =   5 ( 0%)
! G* `. Z& b# @" s0 L8 Z2 Z** # Pins with no good access point on Ver-Grid =    5 ( 0%)

# i& e4 ?3 W7 |2 c   S5 l, ~9 M) a5 R/ I8 Z7 m
若是代表有錯誤的話是否要 Fix 呢?
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