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不知道在這裡問對不對,請問一下,下面這個 書上的 "hello verilog" 例子在modelsim環境下怎麼下command才能link 並且可以產生結果呢
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看usermannual 的語法說明不太了解 不知道哪位大大可以告知一下呢 先謝謝各位了8 c1 \. G- R# x4 a- C$ A' V
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#include "veriuser.h" /*include the file provided in the release dir */6 ?1 n) @2 v* {+ G1 `9 i
R- \& v! E# l; j# r$ pint hello_verilog()
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io_printf("Hello Verilog World\n";/ W4 ~: `6 N8 P; t6 p9 A8 {
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