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[問題求助] charge pump里面的opAMP起什么作用?

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1#
發表於 2007-7-24 14:41:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
看到charge pump里面,有opAMP接在up和down的两路输出电压中间,起什么作用呢,可以不用吗?

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2#
發表於 2007-7-24 21:33:06 | 只看該作者
让Dummy之路跟随实际之路,Dummy之路可以减轻电荷共享和时钟溃通!4 {& B+ Y6 \: u8 u9 b! q% x
不知道我这么理解对不对

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monkeybad + 2 交流分享心得!

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3#
發表於 2007-7-25 02:07:55 | 只看該作者
charge pump基本上可分成single-ended和differential兩種架構+ q, X% V8 Q) a9 R0 W, s
single-ended的charge pump就沒有使用OP Amp的方式(我的印象中)" Z/ _8 R" z" j! ~6 Y- z; ]7 S) L
絕大部份,會在charge pump中使用到OP Amp大都是在differential架構的charge pump
. r6 E- C: @9 N" U: O( b當然,charge pump中要不要用到OP Amp完全是看designer個人的考量與架構的需求( g8 Q: S; G3 s! B+ k
differential charge pump也可以不用OP Amp就可實現
- }2 [: @7 S, B8 K, |: o* w$ M) m) Q, O/ L" D% M( b, h
至於你提到charge pump中使用到OP Amp
5 [" d+ B% E6 W1 u我在IEEE的paper中曾看過兩種這類的charge pump4 U0 u$ R9 E" G1 K
建議你,先看懂內容寫些什麼,絕大部份的IEEE paper都會描述block的動作原理和基本架構運作緣由
9 W& n% F- U/ T: L9 K& ]8 y若你推導一下電路運作模式,我想應該不難理解才對; H0 q: p! n5 z7 b! J7 v" X2 d

$ H; Z' f; }* s2 i另外,PLL的charge pump電路架構,就我個人所知的大概有六種以上- T0 _' C8 S' J' m! [
每一種架構都有不同的考量和優缺點+ U  b9 X5 g3 ]7 }8 z0 A- p( P
如果你真的無法理解paper上的描述,建議你將架構或者電路圖貼到論壇
* K- q- ~& b5 H! y. t9 D( m4 l要不然,誰又會知道你問的是那一種charge pump架構呢??

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yhchang + 3 回答詳細
mt7344 + 3 多謝補充!

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4#
發表於 2007-7-27 08:59:00 | 只看該作者

回復 #1 adele 的帖子

因為你說的不是很清楚9 e' t- k8 S+ k. F+ u  h/ V4 l& k
不過大多數的opamp在charge pump中5 f4 Z' x( _: A* x6 _+ ?: X" Q
都是拿來解決charge sharing$ [" r3 J* g: W& c* z& ^' B1 m6 f& Z
這個算是PLL的一個基礎觀念

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monkeybad + 2 簡單扼要

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5#
發表於 2007-8-9 10:18:28 | 只看該作者
順便帶提一下,請問那在Charge Pump中,我們要注意到up、dn的電流ip是否要match!!
, j: M6 \9 k( r$ Q2 E% P然而在這其中,小弟想問的是,那個ip電流我們在設計時,通常都是設多大呢?為什麼?:o
6#
發表於 2007-8-9 19:08:15 | 只看該作者
電流up和dn當然要match
7 U% {6 J5 Z% v不然charge pump current對low-pass filter的charge和discharge就會出現un-match
- z, |1 ]" Z: N進而影響control VCO的voltage,連帶的也會造成VCO振盪出來的頻率會受到影響+ D7 G1 p  ^2 X( c/ ~

: ^7 |2 _) e* b$ a" ?8 l$ W/ ~至於charge pump current要設到多大
0 P% E# C- q8 T$ v; w& @* T) r這要看你在PLL的設計中,VCO的gain值有多大,damping factor設為多少等等參數才能夠計算出charge pump current在多少值時才是最佳的
; F) p, q  U: M一般來說,charge pump current在10uA - 40uA均可接受,但,實際值乃要利用公式及搭配所有相關參數計算過後才能決定
* E& T0 s' F8 j; J0 X想設計PLL,公式的推導絕對不能少,如果不先了解PLL的運作原理而只是要知道各個block參數為何
8 ^5 f3 P0 L5 ]0 h" n4 p那就無法真正理解PLL的設計精髓為何,更無法設計出最佳化的PLL$ l! c- k9 \* ]+ ?0 z$ x4 w
; u; e/ g% {% T% ~8 f

7 X2 v5 o+ W3 C. k- V$ ]1 B! G6 k, R7 y3 I
1 d* T; a# ]! Y+ e2 y
原帖由 option318 於 2007-8-9 10:18 AM 發表 4 X4 E$ ^% _3 i0 J% [3 V
順便帶提一下,請問那在Charge Pump中,我們要注意到up、dn的電流ip是否要match!!
1 Y% t9 N6 @+ t9 s然而在這其中,小弟想問的是,那個ip電流我們在設計時,通常都是設多大呢?為什麼?:o

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7#
發表於 2007-8-11 15:05:10 | 只看該作者
恩恩!!謝謝”finster” 副版主的說明,小弟總算了解。* I& F$ {, B( ?* G0 z) J+ z
謝謝您的說明唷!!
8#
發表於 2007-8-12 15:45:40 | 只看該作者
我的理解是 加上op 是為了charge sharing 和 不讓電荷變化太大/ u1 Z" T% P4 l4 X' z. C" l& Y
讓ref spurious 增大.而且op 的SR 也會影響spurious 多寡
7 S; b) N0 u+ Y7 H4 Q8 U8 f5 d所以 要小心這個op的設計
" s, \; o0 A9 J, ~$ _( N$ K' F# N: _+ m' [3 u2 ?" [
charge pump電流 我就有點疑問了 , 一般大公司的量產IC ,  Icp 都是mA級的 0 ?+ I2 C+ m% @  `. ?& {
不知道為何paper 都只有數十uA ?
9#
發表於 2007-8-13 10:27:15 | 只看該作者
一般而言,我們所設計的電路都儘量要求low power,也就是整個system的total current要能夠愈小愈好3 k( W) a* G' \2 q
就以PLL而言,最大的current是在VCO,其次是differential-to-singled-eend(D2S)(有的PLL架構並不需要這個block circuit),然後才是charge pump和post-div/pre-div及PFD2 G6 e) M: V7 P: M& V
而在我們所設計的PLL電路中,一般的total current大概都在10mA上下,其中3/4的current是VCO的current所消費掉,當然,如果包含D2S電路的話,這個比例和current值也會有所不同) f( S) |4 t! C6 p8 b: \
. z' Q9 U( l; |
再說明一點,若是純analog PLL,其charge pump current本來就不應該太大,charge pump current愈大,相對的對low-pass filter所作的chrage/discharge的速度也愈大,表示control VCO的voltage變化也愈大,那樣子很容易會讓VCO產生過大的frequency變化,除非VCO本身的gain值就很小,不然charge pump current到達mA都很難控制VCO的frequency7 f+ Z3 O0 ~* I0 m: b
再者,如果charge pump current都己經是mA級了,那VCO的current幾乎都要達到數百mA,那這個樣子的PLL所用掉的current就太大了,現在環保意識抬頭,歐洲一直在提倡綠色能源環保規章,一個PLL會用掉數百mA和一個只會用掉數十mA的PLL,當然是數十mA的取勝
9 d) |- E( S: z% w最後一點,如果PLL要放在SOC當中,其所消費的current絕對不可太大,因為那對整個system和熱源會產生極大的問題,電路所需的current愈大,愈有散熱的問題,對SOC而言,當然會要求PLL所要用的current愈小愈好

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10#
發表於 2007-8-13 13:28:51 | 只看該作者
我的理解是Charge Pump 的电流大小与Loop Filter 参数密切相关,如果Loop Filter  on chip, 那么CP的电流越大,电容就越大,很大的电容集成到芯片上,所占用的面积会大到无法实现的程度,所以电流越小,Loop Filter的电容也相应变小,Loop Filter全集成会成为可能。单纯从功耗来讲,200uA和20uA相比,对整个LL节省功耗有限,但是Loop Filter电容能减小10倍。

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semico_ljj + 2 似乎有一点道理
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11#
發表於 2007-8-13 18:57:50 | 只看該作者
我比較讚同macrohan 說法 . 這比較合理.paper 是有說到過 .% w8 s$ P' d! @( `6 ~  D
就我所知  charge pump current 多少和vco 電流根本沒有關係.
- c! i& j4 @7 @8 Z& u5 U" l不會因為pump current變大 vco current就需要變大.
. O+ K; ]3 l9 P: g, L" g- o5 O這是我所知的 ., i$ L/ M, Z: `. P* j
謝謝各位大大的解說 .
12#
發表於 2007-8-13 19:36:46 | 只看該作者
如果从噪声角度考虑,从传递函数来看,CP电流越大,CP到VCO输出的噪声就越小,电流大了,CP的电流的失配相对小些,传统的PLL,LoopFilter 一般都是外置,所以不考虑环路滤波器电容的大小,所以CP的电流一般在mA级,而在SOC、全集成逐步成为趋势的今天,Loop Filter 全集成,CP的电流再不能达到mA级了,一般都在uA级;

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13#
發表於 2007-8-20 17:02:19 | 只看該作者

回復 #1 adele 的帖子

about your question (回復 #1 adele 的帖子)
9 D7 e+ x. d; {. t+ H6 iplease refer to Razavi's Design of analog CMOS IC  textbook
  [+ F' e9 w3 [( C0 x% Q; hedition 2001 ,page 567  & figure 15.47$ J+ X: K9 V: F5 s$ x, ]! V* P
it's to minimize charge sharing and can decrease vco input ripple voltage# v4 q1 k8 t8 |7 z" l& @  s
( }! g# p4 ?% P$ I
The structure is originally presented on JSSC,vol.SC-23,pp1218-1223,October 1988 (see figure 8 on this paper)
. O. p  p4 ^4 x- _6 [8 r! ^' LA variable delay line pll for CPU-coprocessor synchronization

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semico_ljj + 2 + 2 有了依据
yhchang + 4 + 2 熱心回覆!

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14#
發表於 2009-11-26 17:11:11 | 只看該作者
謝謝大大的分享~知識因分享而壯大!
15#
發表於 2010-1-6 17:00:19 | 只看該作者
謝謝大大的分享~知識因分享而壯大!

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參與人數 1Chipcoin -2 收起 理由
poseidonpid -2 敷衍回覆!何不交流點心得?

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16#
發表於 2010-1-7 17:54:38 | 只看該作者
学习了!谢谢
17#
發表於 2010-1-7 17:55:43 | 只看該作者
我设计的电路一般是20uA∼60uA的样子,VCO功耗大致4∼8mA。
18#
發表於 2010-8-17 21:14:15 | 只看該作者
谢谢分享。3X3X。
  L$ y* f! H- V: ?9 O) l3 V  ?謝謝大大的分享~知識因分享而壯大!
19#
發表於 2010-8-18 13:01:53 | 只看該作者
谢谢分享。3X3X。
+ S4 z  W) S+ a: S' Y謝謝大大的分享~知識因分享而壯大!
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