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[問題求助] charge pump里面的opAMP起什么作用?

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1#
發表於 2007-7-24 14:41:01 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
看到charge pump里面,有opAMP接在up和down的两路输出电压中间,起什么作用呢,可以不用吗?

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semico_ljj + 2 提了一个好问题·
yhchang + 4 Good question!

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19#
發表於 2010-8-18 13:01:53 | 只看該作者
谢谢分享。3X3X。/ w+ W; L5 ^* }9 ~
謝謝大大的分享~知識因分享而壯大!
18#
發表於 2010-8-17 21:14:15 | 只看該作者
谢谢分享。3X3X。
( ?% _1 t; E' ~+ ?# P謝謝大大的分享~知識因分享而壯大!
17#
發表於 2010-1-7 17:55:43 | 只看該作者
我设计的电路一般是20uA∼60uA的样子,VCO功耗大致4∼8mA。
16#
發表於 2010-1-7 17:54:38 | 只看該作者
学习了!谢谢
15#
發表於 2010-1-6 17:00:19 | 只看該作者
謝謝大大的分享~知識因分享而壯大!

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參與人數 1Chipcoin -2 收起 理由
poseidonpid -2 敷衍回覆!何不交流點心得?

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14#
發表於 2009-11-26 17:11:11 | 只看該作者
謝謝大大的分享~知識因分享而壯大!
13#
發表於 2007-8-20 17:02:19 | 只看該作者

回復 #1 adele 的帖子

about your question (回復 #1 adele 的帖子)
3 E  A, T2 B0 Q$ qplease refer to Razavi's Design of analog CMOS IC  textbook $ S8 e; K5 g& g% g
edition 2001 ,page 567  & figure 15.47. j# @8 V" _- K& w( ]
it's to minimize charge sharing and can decrease vco input ripple voltage5 _% q" L" Y$ t$ g: j* b  p, y' r
6 y3 m! m; R9 k! w$ V9 m* A9 K2 ~; ?
The structure is originally presented on JSSC,vol.SC-23,pp1218-1223,October 1988 (see figure 8 on this paper)0 G* g, U& Z+ A1 @& A* d* l
A variable delay line pll for CPU-coprocessor synchronization

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參與人數 2Chipcoin +6 +4 收起 理由
semico_ljj + 2 + 2 有了依据
yhchang + 4 + 2 熱心回覆!

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12#
發表於 2007-8-13 19:36:46 | 只看該作者
如果从噪声角度考虑,从传递函数来看,CP电流越大,CP到VCO输出的噪声就越小,电流大了,CP的电流的失配相对小些,传统的PLL,LoopFilter 一般都是外置,所以不考虑环路滤波器电容的大小,所以CP的电流一般在mA级,而在SOC、全集成逐步成为趋势的今天,Loop Filter 全集成,CP的电流再不能达到mA级了,一般都在uA级;

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yhchang + 6 + 3 Good answer! 優質答案!

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11#
發表於 2007-8-13 18:57:50 | 只看該作者
我比較讚同macrohan 說法 . 這比較合理.paper 是有說到過 .
0 M/ i+ d/ A' u+ u; x2 L就我所知  charge pump current 多少和vco 電流根本沒有關係.9 J4 O( X1 o2 B7 [0 `+ G- k
不會因為pump current變大 vco current就需要變大.
: d% C% o4 ^; J" B$ N; s這是我所知的 .
! j; ]9 X" `3 |. A4 t6 {謝謝各位大大的解說 .
10#
發表於 2007-8-13 13:28:51 | 只看該作者
我的理解是Charge Pump 的电流大小与Loop Filter 参数密切相关,如果Loop Filter  on chip, 那么CP的电流越大,电容就越大,很大的电容集成到芯片上,所占用的面积会大到无法实现的程度,所以电流越小,Loop Filter的电容也相应变小,Loop Filter全集成会成为可能。单纯从功耗来讲,200uA和20uA相比,对整个LL节省功耗有限,但是Loop Filter电容能减小10倍。

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參與人數 2Chipcoin +6 +5 收起 理由
semico_ljj + 2 似乎有一点道理
yhchang + 6 + 3 Good answer! 優質答案!

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9#
發表於 2007-8-13 10:27:15 | 只看該作者
一般而言,我們所設計的電路都儘量要求low power,也就是整個system的total current要能夠愈小愈好
' P" G+ V, p9 ?, ]  o3 ~+ z就以PLL而言,最大的current是在VCO,其次是differential-to-singled-eend(D2S)(有的PLL架構並不需要這個block circuit),然後才是charge pump和post-div/pre-div及PFD) N1 ~  n2 @7 c3 ~& z, g
而在我們所設計的PLL電路中,一般的total current大概都在10mA上下,其中3/4的current是VCO的current所消費掉,當然,如果包含D2S電路的話,這個比例和current值也會有所不同
1 N3 \# q5 g9 k) I; o
: X2 N* W  |+ V$ p3 c再說明一點,若是純analog PLL,其charge pump current本來就不應該太大,charge pump current愈大,相對的對low-pass filter所作的chrage/discharge的速度也愈大,表示control VCO的voltage變化也愈大,那樣子很容易會讓VCO產生過大的frequency變化,除非VCO本身的gain值就很小,不然charge pump current到達mA都很難控制VCO的frequency; f: F8 O5 ]0 L- V9 {7 Z: G
再者,如果charge pump current都己經是mA級了,那VCO的current幾乎都要達到數百mA,那這個樣子的PLL所用掉的current就太大了,現在環保意識抬頭,歐洲一直在提倡綠色能源環保規章,一個PLL會用掉數百mA和一個只會用掉數十mA的PLL,當然是數十mA的取勝# C9 T/ K7 |& h& N! R: G
最後一點,如果PLL要放在SOC當中,其所消費的current絕對不可太大,因為那對整個system和熱源會產生極大的問題,電路所需的current愈大,愈有散熱的問題,對SOC而言,當然會要求PLL所要用的current愈小愈好

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yhchang + 3 Good answer!

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8#
發表於 2007-8-12 15:45:40 | 只看該作者
我的理解是 加上op 是為了charge sharing 和 不讓電荷變化太大
" C: h, v" \- i( ], \: k- I0 l讓ref spurious 增大.而且op 的SR 也會影響spurious 多寡
  E4 R* C; U+ _2 `6 m' Y6 O所以 要小心這個op的設計
7 m1 C2 @6 X& w0 w  z3 n/ m1 S7 S! a  l3 E) R' R
charge pump電流 我就有點疑問了 , 一般大公司的量產IC ,  Icp 都是mA級的
$ |- c+ d: y6 T不知道為何paper 都只有數十uA ?
7#
發表於 2007-8-11 15:05:10 | 只看該作者
恩恩!!謝謝”finster” 副版主的說明,小弟總算了解。  G5 z5 e- r; [* f; J. J% g
謝謝您的說明唷!!
6#
發表於 2007-8-9 19:08:15 | 只看該作者
電流up和dn當然要match' d6 h! |- T% u; Z
不然charge pump current對low-pass filter的charge和discharge就會出現un-match
9 k& t. e. z$ e+ {- P" o( a! ]  _進而影響control VCO的voltage,連帶的也會造成VCO振盪出來的頻率會受到影響0 m4 W) j% K) G2 y6 A. V5 c

6 E8 w% V9 U$ O  ~0 E! e( n至於charge pump current要設到多大/ \: }1 z( K  B" T/ ^
這要看你在PLL的設計中,VCO的gain值有多大,damping factor設為多少等等參數才能夠計算出charge pump current在多少值時才是最佳的0 k1 e1 x4 @5 ]- u$ a/ s
一般來說,charge pump current在10uA - 40uA均可接受,但,實際值乃要利用公式及搭配所有相關參數計算過後才能決定, o/ g+ a6 l- t4 T1 ~
想設計PLL,公式的推導絕對不能少,如果不先了解PLL的運作原理而只是要知道各個block參數為何
2 E9 r$ Q1 V7 y4 d那就無法真正理解PLL的設計精髓為何,更無法設計出最佳化的PLL8 W5 s$ P* s7 e% s  B

. q5 b7 Q5 n& ^4 f9 X/ d+ U8 I, v- C" T2 L
8 L  m+ A+ s. z0 [! Z% G9 ?
3 G. _0 ^; p% w7 a( u
原帖由 option318 於 2007-8-9 10:18 AM 發表 0 Q" Y3 V* O: G4 ^; a+ f& p
順便帶提一下,請問那在Charge Pump中,我們要注意到up、dn的電流ip是否要match!!  g) c; q7 z- @3 `: Z
然而在這其中,小弟想問的是,那個ip電流我們在設計時,通常都是設多大呢?為什麼?:o

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5#
發表於 2007-8-9 10:18:28 | 只看該作者
順便帶提一下,請問那在Charge Pump中,我們要注意到up、dn的電流ip是否要match!!
/ o1 j0 a) _8 ?# w然而在這其中,小弟想問的是,那個ip電流我們在設計時,通常都是設多大呢?為什麼?:o
4#
發表於 2007-7-27 08:59:00 | 只看該作者

回復 #1 adele 的帖子

因為你說的不是很清楚
$ W" f, ^" Q6 ^7 X不過大多數的opamp在charge pump中
/ ?+ [! p) M9 ~' v2 [" j都是拿來解決charge sharing8 K2 O# ~/ R3 s! O
這個算是PLL的一個基礎觀念

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monkeybad + 2 簡單扼要

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3#
發表於 2007-7-25 02:07:55 | 只看該作者
charge pump基本上可分成single-ended和differential兩種架構* a, k. ^( w' |- x% p9 B8 b
single-ended的charge pump就沒有使用OP Amp的方式(我的印象中)
% t+ U5 C) o/ b' U絕大部份,會在charge pump中使用到OP Amp大都是在differential架構的charge pump& S4 L  i$ `+ \  k
當然,charge pump中要不要用到OP Amp完全是看designer個人的考量與架構的需求
5 j- g) s6 b. ~1 hdifferential charge pump也可以不用OP Amp就可實現: M) U- ]: l2 O) C/ K% e
8 K+ |* g6 q" H% E! ^
至於你提到charge pump中使用到OP Amp# b  V2 U/ e4 e. t. e" {
我在IEEE的paper中曾看過兩種這類的charge pump/ R- X2 l' O; k6 ~: r7 \# S. R) T
建議你,先看懂內容寫些什麼,絕大部份的IEEE paper都會描述block的動作原理和基本架構運作緣由
# B( }8 z- b1 y! \% Y( I若你推導一下電路運作模式,我想應該不難理解才對! s% @0 b; t! c. B- F
1 J6 p- z: f% D" |2 d* T% P) r. R
另外,PLL的charge pump電路架構,就我個人所知的大概有六種以上
" s4 m6 [1 w8 y5 Q每一種架構都有不同的考量和優缺點
4 s8 F  i7 o; E7 W如果你真的無法理解paper上的描述,建議你將架構或者電路圖貼到論壇
4 r' _; d; k6 u& u$ j0 ?5 G要不然,誰又會知道你問的是那一種charge pump架構呢??

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yhchang + 3 回答詳細
mt7344 + 3 多謝補充!

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2#
發表於 2007-7-24 21:33:06 | 只看該作者
让Dummy之路跟随实际之路,Dummy之路可以减轻电荷共享和时钟溃通!/ p7 _4 I9 ^- v+ r# N1 E& O
不知道我这么理解对不对

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參與人數 2Chipcoin +6 +2 收起 理由
yhchang + 4 + 2 Good answer! 優質答案!
monkeybad + 2 交流分享心得!

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